(一) 細(xì)節(jié)決定成敗PCB設(shè)計是一個細(xì)致的工作，需要的就是細(xì)心和耐心。剛開始做設(shè)計的新手經(jīng)常犯的錯誤就是一些細(xì)節(jié)錯誤。器件管腳弄錯了，器件封裝用錯了，管腳順序畫反了等等，有些可以通過飛線來解決，有些可能就讓一塊板子直接變成了廢品。畫封裝的時候多檢查一遍，投板之前把封裝打印出來和實(shí)際器件比一下，多看一眼，多檢查一遍不是強(qiáng)迫癥，只是讓這些容易犯的低級錯誤盡量避免。否則設(shè)計的再好看的板子，上面布滿飛線，也就遠(yuǎn)談不上優(yōu)秀了。(二) 學(xué)會設(shè)置規(guī)則其實(shí)現(xiàn)在不光高級的PCB設(shè)計軟件需要設(shè)置布線規(guī)則，一些簡單易用的PCB工具同樣可以進(jìn)行規(guī)則設(shè)置。人腦畢竟不是機(jī)器，那就難免會有疏忽有失誤。所以把一些容易忽略的問題設(shè)置到規(guī)則里面，讓電腦幫助我們檢查，盡量避免犯一些低級錯誤。另外，完善的規(guī)則設(shè)置能更好的規(guī)范后面的工作。所謂磨刀不誤砍柴工，板子的規(guī)模越復(fù)雜規(guī)則設(shè)置的重要性越突出。現(xiàn)在很多EDA工具都有自動布線功能，如果規(guī)則設(shè)置足夠詳細(xì)，讓工具自己幫你去設(shè)計，你在一旁喝杯咖啡，不是更愜意的事情嗎?(三) 為別人考慮的越多，自己的工作越少在進(jìn)行PCB設(shè)計的時候，盡量多考慮一些最終使用者的需求。比如，如果設(shè)計的是一塊開發(fā)板，那么在進(jìn)行PCB設(shè)計的時候就要考慮放置更多的絲印信息，這樣在使用的時候會更方便，不用來回的查找原理圖或者找設(shè)計人員支持了。如果設(shè)計的是一個量產(chǎn)產(chǎn)品，那么就要更多的考慮到生產(chǎn)線上會遇到的問題，同類型的器件盡量方向一致，器件間距是否合適，板子的工藝邊寬度等等。這些問題考慮的越早，越不會影響后面的設(shè)計，也可以減少后面支持的工作量和改板的次數(shù)?？瓷先ラ_始設(shè)計上用的時間增加了，實(shí)際上是減少了自己后續(xù)的工作量。在板子空間信號允許的情況下，盡量放置更多的測試點(diǎn)，提高板子的可測性，這樣在后續(xù)調(diào)試階段同樣能節(jié)省更多的時間，給發(fā)現(xiàn)問題提供更多的思路。(四) 畫好原理圖很多工程師都覺得layout工作更重要一些，原理圖就是為了生成網(wǎng)表方便PCB做檢查用的。其實(shí)，在后續(xù)電路調(diào)試過程中原理圖的作用會更大一些。無論是查找問題還是和同事交流，還是原理圖更直觀更方便。另外養(yǎng)成在原理圖中做標(biāo)注的習(xí)慣，把各部分電路在layout的時候要注意到的問題標(biāo)注在原理圖上，對自己或者對別人都是一個很好的提醒。層次化原理圖，把不同功能不同模塊的電路分成不同的頁，這樣無論是讀圖還是以后重復(fù)使用都能明顯的減少工作量。使用成熟的設(shè)計總是要比設(shè)計新電路的風(fēng)險小。每次看到把所有電路都放在一張圖紙上，一片密密麻麻的器件，腦袋就能大一圈。

現(xiàn)在市面上流行的EDA工具軟件很多，但除了使用的術(shù)語和功能鍵的位置不一樣外都大同小異，如何用這些工具更好地實(shí)現(xiàn)PCB的設(shè)計呢?在開始布線之前對設(shè)計進(jìn)行認(rèn)真的分析以及對工具軟件進(jìn)行認(rèn)真的設(shè)置將使設(shè)計更加符合要求。下面是一般的設(shè)計過程和步驟。1、確定PCB的層數(shù)電路板尺寸和布線層數(shù)需要在設(shè)計初期確定。如果設(shè)計要求使用高密度球柵數(shù)組(BGA)組件，就必須考慮這些器件布線所需要的最少布線層數(shù)。布線層的數(shù)量以及層疊(stack-up)方式會直接影響到印制線的布線和阻抗。板的大小有助于確定層疊方式和印制線寬度，實(shí)現(xiàn)期望的設(shè)計效果。多年來，人們總是認(rèn)為電路板層數(shù)越少成本就越低，但是影響電路板的制造成本還有許多其它因素。近幾年來，多層板之間的成本差別已經(jīng)大大減小。在開始設(shè)計時最好采用較多的電路層并使敷銅均勻分布，以避免在設(shè)計臨近結(jié)束時才發(fā)現(xiàn)有少量信號不符合已定義的規(guī)則以及空間要求，從而被迫添加新層。在設(shè)計之前認(rèn)真的規(guī)劃將減少布線中很多的麻煩。2、設(shè)計規(guī)則和限制自動布線工具本身并不知道應(yīng)該做些什幺。為完成布線任務(wù)，布線工具需要在正確的規(guī)則和限制條件下工作。不同的信號線有不同的布線要求，要對所有特殊要求的信號線進(jìn)行分類，不同的設(shè)計分類也不一樣。每個信號類都應(yīng)該有優(yōu)先級，優(yōu)先級越高，規(guī)則也越嚴(yán)格。規(guī)則涉及印制線寬度、過孔的最大數(shù)量、平行度、信號線之間的相互影響以及層的限制，這些規(guī)則對布線工具的性能有很大影響。認(rèn)真考慮設(shè)計要求是成功布線的重要一步。

開發(fā)貼片SMTPCB布局規(guī)則1、在通常情況下，所有的元件均應(yīng)布置在電路板的同一面上，只有頂層元件過密時，貼片SMT加工廠才能將一些高度有限并且發(fā)熱量小的器件，如貼片電阻、貼片電容、貼片IC等放在底層。2、在保證電氣性能的前提下，元件應(yīng)放置在柵格上且相互平行或垂直排列，以求整齊、美觀，在一般情況下不允許元件重疊;元件排列要緊湊，元件在整個版面上應(yīng)分布均勻、疏密一致。3、電路板上不同組件相臨焊盤圖形之間的最小間距應(yīng)在1MM以上。4、離電路板邊緣一般不小于2MM.電路板的最佳形狀為矩形，長寬比為3:2或4:3.電路板面尺大于200MM乘150MM時，應(yīng)考慮電路板所能承受的機(jī)械強(qiáng)度。PCB設(shè)計設(shè)置技巧PCB設(shè)計在不同階段需要進(jìn)行不同的各點(diǎn)設(shè)置，在布局階段可以采用大格點(diǎn)進(jìn)行器件布局;對于IC、非定位接插件等大器件，可以選用50~100mil的格點(diǎn)精度進(jìn)行布局，而對于電阻電容和電感等無源小器件，可采用25mil的格點(diǎn)進(jìn)行布局。大格點(diǎn)的精度有利于器件的對齊和布局的美觀。PCB設(shè)計布局技巧在PCB的布局設(shè)計中要分析電路板的單元，依據(jù)起功能進(jìn)行布局設(shè)計，對電路的全部元器件進(jìn)行布局時，要符合以下原則：1、按照電路的流程安排各個功能電路單元的位置，使布局便于信號流通，并使信號盡可能保持一致的方向。2、以每個功能單元的核心元器件為中心，圍繞他來進(jìn)行布局。元器件應(yīng)均勻、整體、緊湊的排列在PCB上，盡量減少和縮短各元器件之間的引線和連接。3、在高頻下工作的電路，要考慮元器件之間的分布參數(shù)。一般電路應(yīng)盡可能使元器件并行排列，這樣不但美觀，而且裝旱容易，易于批量生產(chǎn)。

Via hole導(dǎo)通孔起線路互相連結(jié)導(dǎo)通的作用，電子行業(yè)的發(fā)展，同時也促進(jìn)PCB的發(fā)展，也對印制板制作工藝和表面貼裝技術(shù)提出更高要求。Via hole塞孔工藝應(yīng)運(yùn)而生，同時應(yīng)滿足下列要求：(一)導(dǎo)通孔內(nèi)有銅即可，阻焊可塞可不塞;(二)導(dǎo)通孔內(nèi)必須有錫鉛，有一定的厚度要求(4微米)，不得有阻焊油墨入孔，造成孔內(nèi)藏錫珠;(三)導(dǎo)通孔必須有阻焊油墨塞孔，不透光，不得有錫圈，錫珠以及平整等要求。隨著電子產(chǎn)品向“輕、薄、短、小”方向發(fā)展，PCB也向高密度、高難度發(fā)展，因此出現(xiàn)大量SMT、BGA的PCB，而客戶在貼裝元器件時要求塞孔，主要有五個作用：(一)防止PCB過波峰焊時錫從導(dǎo)通孔貫穿元件面造成短路;特別是我們把過孔放在BGA焊盤上時，就必須先做塞孔，再鍍金處理，便于BGA的焊接。(二)避免助焊劑殘留在導(dǎo)通孔內(nèi);(三)電子廠表面貼裝以及元件裝配完成后PCB在測試機(jī)上要吸真空形成負(fù)壓才完成：(四)防止表面錫膏流入孔內(nèi)造成虛焊，影響貼裝;

相信對做硬件的工程師，畢業(yè)開始進(jìn)公司時，在設(shè)計PCB時，老工程師都會對他說，PCB走線不要走直角，走線一定要短，電容一定要就近擺放等等。但是一開始我們可能都不了解為什么這樣做，就憑他們的幾句經(jīng)驗(yàn)對我們來說是遠(yuǎn)遠(yuǎn)不夠的哦，當(dāng)然如果你沒有注意這些細(xì)節(jié)問題，今后又犯了，可能又會被他們罵，“都說了多少遍了電容一定要就近擺放，放遠(yuǎn)了起不到效果等等”，往往經(jīng)驗(yàn)告訴我們其實(shí)那些老工程師也是只有一部分人才真正掌握其中的奧妙，我們一開始不會也不用難過，多看看資料很快就能掌握的。直到被罵好幾次后我們回去找相關(guān)資料，為什么設(shè)計PCB電容要就近擺放呢，等看了資料后就能了解一些，可是網(wǎng)上的資料很雜散，很少能找到一個很全方面講解的。下面這些內(nèi)容是我轉(zhuǎn)載的一篇關(guān)于電容去耦半徑的講解，相信你看了之后可以很牛x的回答和避免類似問題的發(fā)生。老師問： 為什么去耦電容就近擺放呢?學(xué)生答： 因?yàn)樗杏行О霃脚?，放的遠(yuǎn)了失效的。電容去耦的一個重要問題是電容的去耦半徑。大多數(shù)資料中都會提到電容擺放要盡量靠近芯片，多數(shù)資料都是從減小回路電感的角度來談這個擺放距離問題。確實(shí)，減小電感是一個重要原因，但是還有一個重要的原因大多數(shù)資料都沒有提及，那就是電容去耦半徑問題。如果電容擺放離芯片過遠(yuǎn)，超出了它的去耦半徑，電容將失去它的去耦的作用。理解去耦半徑最好的辦法就是考察噪聲源和電容補(bǔ)償電流之間的相位關(guān)系。當(dāng)芯片對電流的需求發(fā)生變化時，會在電源平面的一個很小的局部區(qū)域內(nèi)產(chǎn)生電壓擾動，電容要補(bǔ)償這一電流(或電壓)，就必須先感知到這個電壓擾動。信號在介質(zhì)中傳播需要一定的時間，因此從發(fā)生局部電壓擾動到電容感知到這一擾動之間有一個時間延遲。同樣，電容的補(bǔ)償電流到達(dá)擾動區(qū)也需要一個延遲。因此必然造成噪聲源和電容補(bǔ)償電流之間的相位上的不一致。