PCB設(shè)計(jì)是一個(gè)細(xì)致的工作，需要的就是細(xì)心和耐心。剛開始做設(shè)計(jì)的新手經(jīng)常犯的錯(cuò)誤就是一些細(xì)節(jié)錯(cuò)誤。器件管腳弄錯(cuò)了，器件封裝用錯(cuò)了，管腳順序畫反了等等，有些可以通過飛線來解決，有些可能就讓一塊板子直接變成了廢品。畫封裝的時(shí)候多檢查一遍，投板之前把封裝打印出來和實(shí)際器件比一下，多看一眼，多檢查一遍不是強(qiáng)迫癥，只是讓這些容易犯的低級錯(cuò)誤盡量避免。否則設(shè)計(jì)的再好看的板子，上面布滿飛線，也就遠(yuǎn)談不上優(yōu)秀了。(二) 學(xué)會設(shè)置規(guī)則其實(shí)現(xiàn)在不光高級的PCB設(shè)計(jì)軟件需要設(shè)置布線規(guī)則，一些簡單易用的PCB工具同樣可以進(jìn)行規(guī)則設(shè)置。人腦畢竟不是機(jī)器，那就難免會有疏忽有失誤。所以把一些容易忽略的問題設(shè)置到規(guī)則里面，讓電腦幫助我們檢查，盡量避免犯一些低級錯(cuò)誤。另外，完善的規(guī)則設(shè)置能更好的規(guī)范后面的工作。所謂磨刀不誤砍柴工，板子的規(guī)模越復(fù)雜規(guī)則設(shè)置的重要性越突出?，F(xiàn)在很多EDA工具都有自動(dòng)布線功能，如果規(guī)則設(shè)置足夠詳細(xì)，讓工具自己幫你去設(shè)計(jì)，你在一旁喝杯咖啡，不是更愜意的事情嗎?(三) 為別人考慮的越多，自己的工作越少在進(jìn)行PCB設(shè)計(jì)的時(shí)候，盡量多考慮一些最終使用者的需求。比如，如果設(shè)計(jì)的是一塊開發(fā)板，那么在進(jìn)行PCB設(shè)計(jì)的時(shí)候就要考慮放置更多的絲印信息，這樣在使用的時(shí)候會更方便，不用來回的查找原理圖或者找設(shè)計(jì)人員支持了。如果設(shè)計(jì)的是一個(gè)量產(chǎn)產(chǎn)品，那么就要更多的考慮到生產(chǎn)線上會遇到的問題，同類型的器件盡量方向一致，器件間距是否合適，板子的工藝邊寬度等等。這些問題考慮的越早，越不會影響后面的設(shè)計(jì)，也可以減少后面支持的工作量和改板的次數(shù)?？瓷先ラ_始設(shè)計(jì)上用的時(shí)間增加了，實(shí)際上是減少了自己后續(xù)的工作量。在板子空間信號允許的情況下，盡量放置更多的測試點(diǎn)，提高板子的可測性，這樣在后續(xù)調(diào)試階段同樣能節(jié)省更多的時(shí)間，給發(fā)現(xiàn)問題提供更多的思路。

【第Y招】多層板布線高頻電路往往集成度較高，布線密度大，采用多層板既是布線所必須，也是降低干擾的有效手段。在PCB Layout階段，合理的選擇一定層數(shù)的印制板尺寸，能充分利用中間層來設(shè)置屏蔽，更好地實(shí)現(xiàn)就近接地，并有效地降低寄生電感和縮短信號的傳輸長度，同時(shí)還能大幅度地降低信號的交叉干擾等，所有這些方法都對高頻電路的可靠性有利。有資料顯示，同種材料時(shí)，四層板要比雙面板的噪聲低20dB。但是，同時(shí)也存在一個(gè)問題，PCB半層數(shù)越高，制造工藝越復(fù)雜，單位成本也就越高，這就要求我們在進(jìn)行PCB Layout時(shí)，除了選擇合適的層數(shù)的PCB板，還需要進(jìn)行合理的元器件布局規(guī)劃，并采用正確的布線規(guī)則來完成設(shè)計(jì)。　　【第二招】高速電子器件管腳間的引線彎折越少越好　　高頻電路布線的引線最好采用全直線，需要轉(zhuǎn)折，可用45度折線或者圓弧轉(zhuǎn)折，這種要求在低頻電路中僅僅用于提高銅箔的固著強(qiáng)度，而在高頻電路中，滿足這一要求卻可以減少高頻信號對外的發(fā)射和相互間的耦合?！　　镜谌小扛哳l電路器件管腳間的引線越短越好　　信號的輻射強(qiáng)度是和信號線的走線長度成正比的，高頻的信號引線越長，它就越容易耦合到靠近它的元器件上去，所以對于諸如信號的時(shí)鐘、晶振、DDR的數(shù)據(jù)、LVDS線、USB線、HDMI線等高頻信號線都是要求盡可能的走線越短越好?！　　镜谒恼小扛哳l電路器件管腳間的引線層間交替越少越好　　所謂“引線的層間交替越少越好”是指元件連接過程中所用的過孔(Via)越少越好。據(jù)側(cè)，一個(gè)過孔可帶來約0.5pF的分布電容，減少過孔數(shù)能顯著提高速度和減少數(shù)據(jù)出錯(cuò)的可能性。

PCB上的任何一條走線在通過高頻信號的情況下都會對該信號造成時(shí)延時(shí)，蛇形走線的主要作用是補(bǔ)償“同一組相關(guān)”信號線中延時(shí)較小的部分，這些部分通常是沒有或比其它信號少通過另外的邏輯處理;最典型的就是時(shí)鐘線，通常它不需經(jīng)過任何其它邏輯處理，因而其延時(shí)會小于其它相關(guān)信號。高速數(shù)字PCB板的等線長是為了使各信號的延遲差保持在一個(gè)范圍內(nèi),保證系統(tǒng)在同一周期內(nèi)讀取的數(shù)據(jù)的有效性(延遲差超過一個(gè)時(shí)鐘周期時(shí)會錯(cuò)讀下一周期的數(shù)據(jù)),一般要求延遲差不超過1/4時(shí)鐘周期,單位長度的線延遲差也是固定的,延遲跟線寬,線長,銅厚,板層結(jié)構(gòu)有關(guān),但線過長會增大分布電容和分布電感,使信號質(zhì)量,所以時(shí)鐘IC引腳一般都接RC端接,但蛇形走線并非起電感的作用,相反的,電感會使信號中的上升元中的高次諧波相移,造成信號質(zhì)量惡化,所以要求蛇形線間距最少是線寬的兩倍,信號的上升時(shí)間越小就越易受分布電容和分布電感的影響.因?yàn)閼?yīng)用場合不同具不同的作用,如果蛇形走線在電腦板中出現(xiàn)，其主要起到一個(gè)濾波電感的作用，提高電路的抗干擾能力，電腦主機(jī)板中的蛇形走線，主要用在一些時(shí)鐘信號中，如CIClk,AGPClk，它的作用有兩點(diǎn)：1、阻抗匹配2、濾波電感。對一些重要信號，如INTEL HUB架構(gòu)中的HUBLink，一共13根，跑233MHz，要求必須嚴(yán)格等長，以消除時(shí)滯造成的隱患，繞線是解決辦法。一般來講，蛇形走線的線距>=2倍的線寬。PCI板上的蛇行線就是為了適應(yīng)PCI33MHzClock的線長要求。若在一般普通PCB板中，是一個(gè)分布參數(shù)的 LC濾波器，還可作為收音機(jī)天線的電感線圈，短而窄的蛇形走線可做保險(xiǎn)絲等等.

安徽開發(fā)FPC軟板1、PCB分板機(jī)對于運(yùn)轉(zhuǎn)問題的原因：蓄電池沒有充足電力，蓄電池和啟動(dòng)電機(jī)之間的連接斷開。開發(fā)FPC軟板蓄電池或接線卡子出現(xiàn)的氧化的現(xiàn)象;電磁開關(guān)與兩大接線柱接觸不良或是導(dǎo)流片被嚴(yán)重?zé)g;電刷出現(xiàn)磨損、折斷或是電刷卡在刷架中;電刷整流器間存在油污或是整流片的嚴(yán)重?zé)g。2、繞組部分短路或斷路：有三個(gè)原因會出現(xiàn)這種情況，一是電樞繞組或是換向器片出現(xiàn)脫焊現(xiàn)象，二是軸承或銅套出現(xiàn)磨損導(dǎo)致轉(zhuǎn)子掃膛，三是在安裝的時(shí)候4個(gè)電刷的位置裝錯(cuò)了或是新?lián)Q的軸套間隙過大。PCB分板機(jī)啟動(dòng)時(shí)空轉(zhuǎn)：撥叉安裝不正確，撥叉滑柱裝置在挪動(dòng)襯套內(nèi)讓電動(dòng)機(jī)齒輪不可能與撥叉一同轉(zhuǎn)動(dòng)。3.PCB分板機(jī)啟動(dòng)電機(jī)就會轉(zhuǎn)動(dòng)。電磁開關(guān)鐵芯和接盤推桿間間的間隙太大會造成單向離合器打滑，無法帶動(dòng)飛輪齒圈轉(zhuǎn)動(dòng)。啟動(dòng)電機(jī)齒輪一旦嚴(yán)重磨損，就會無法與飛輪齒圈很好地磨合。電磁開關(guān)常吸常開，是指在按下啟動(dòng)開關(guān)后，電磁開關(guān)的鐵芯剛被吸上去就會馬上脫下來，脫下來后又會被吸上去，然后又馬上脫下來，達(dá)不到啟動(dòng)發(fā)起機(jī)的效果1。呈現(xiàn)這種毛病現(xiàn)象的常見緣由是堅(jiān)持線圈斷路。

相信對做硬件的工程師，畢業(yè)開始進(jìn)公司時(shí)，在設(shè)計(jì)PCB時(shí)，老工程師都會對他說，PCB走線不要走直角，走線一定要短，電容一定要就近擺放等等。但是一開始我們可能都不了解為什么這樣做，就憑他們的幾句經(jīng)驗(yàn)對我們來說是遠(yuǎn)遠(yuǎn)不夠的哦，當(dāng)然如果你沒有注意這些細(xì)節(jié)問題，今后又犯了，可能又會被他們罵，“都說了多少遍了電容一定要就近擺放，放遠(yuǎn)了起不到效果等等”，往往經(jīng)驗(yàn)告訴我們其實(shí)那些老工程師也是只有一部分人才真正掌握其中的奧妙，我們一開始不會也不用難過，多看看資料很快就能掌握的。直到被罵好幾次后我們回去找相關(guān)資料，為什么設(shè)計(jì)PCB電容要就近擺放呢，等看了資料后就能了解一些，可是網(wǎng)上的資料很雜散，很少能找到一個(gè)很全方面講解的。下面這些內(nèi)容是我轉(zhuǎn)載的一篇關(guān)于電容去耦半徑的講解，相信你看了之后可以很牛x的回答和避免類似問題的發(fā)生。老師問： 為什么去耦電容就近擺放呢?學(xué)生答： 因?yàn)樗杏行О霃脚叮诺倪h(yuǎn)了失效的。電容去耦的一個(gè)重要問題是電容的去耦半徑。大多數(shù)資料中都會提到電容擺放要盡量靠近芯片，多數(shù)資料都是從減小回路電感的角度來談這個(gè)擺放距離問題。確實(shí)，減小電感是一個(gè)重要原因，但是還有一個(gè)重要的原因大多數(shù)資料都沒有提及，那就是電容去耦半徑問題。如果電容擺放離芯片過遠(yuǎn)，超出了它的去耦半徑，電容將失去它的去耦的作用。理解去耦半徑最好的辦法就是考察噪聲源和電容補(bǔ)償電流之間的相位關(guān)系。當(dāng)芯片對電流的需求發(fā)生變化時(shí)，會在電源平面的一個(gè)很小的局部區(qū)域內(nèi)產(chǎn)生電壓擾動(dòng)，電容要補(bǔ)償這一電流(或電壓)，就必須先感知到這個(gè)電壓擾動(dòng)。信號在介質(zhì)中傳播需要一定的時(shí)間，因此從發(fā)生局部電壓擾動(dòng)到電容感知到這一擾動(dòng)之間有一個(gè)時(shí)間延遲。同樣，電容的補(bǔ)償電流到達(dá)擾動(dòng)區(qū)也需要一個(gè)延遲。因此必然造成噪聲源和電容補(bǔ)償電流之間的相位上的不一致。

(一) 細(xì)節(jié)決定成敗PCB設(shè)計(jì)是一個(gè)細(xì)致的工作，需要的就是細(xì)心和耐心。剛開始做設(shè)計(jì)的新手經(jīng)常犯的錯(cuò)誤就是一些細(xì)節(jié)錯(cuò)誤。器件管腳弄錯(cuò)了，器件封裝用錯(cuò)了，管腳順序畫反了等等，有些可以通過飛線來解決，有些可能就讓一塊板子直接變成了廢品。畫封裝的時(shí)候多檢查一遍，投板之前把封裝打印出來和實(shí)際器件比一下，多看一眼，多檢查一遍不是強(qiáng)迫癥，只是讓這些容易犯的低級錯(cuò)誤盡量避免。否則設(shè)計(jì)的再好看的板子，上面布滿飛線，也就遠(yuǎn)談不上優(yōu)秀了。(二) 學(xué)會設(shè)置規(guī)則其實(shí)現(xiàn)在不光高級的PCB設(shè)計(jì)軟件需要設(shè)置布線規(guī)則，一些簡單易用的PCB工具同樣可以進(jìn)行規(guī)則設(shè)置。人腦畢竟不是機(jī)器，那就難免會有疏忽有失誤。所以把一些容易忽略的問題設(shè)置到規(guī)則里面，讓電腦幫助我們檢查，盡量避免犯一些低級錯(cuò)誤。另外，完善的規(guī)則設(shè)置能更好的規(guī)范后面的工作。所謂磨刀不誤砍柴工，板子的規(guī)模越復(fù)雜規(guī)則設(shè)置的重要性越突出?，F(xiàn)在很多EDA工具都有自動(dòng)布線功能，如果規(guī)則設(shè)置足夠詳細(xì)，讓工具自己幫你去設(shè)計(jì)，你在一旁喝杯咖啡，不是更愜意的事情嗎?(三) 為別人考慮的越多，自己的工作越少在進(jìn)行PCB設(shè)計(jì)的時(shí)候，盡量多考慮一些最終使用者的需求。比如，如果設(shè)計(jì)的是一塊開發(fā)板，那么在進(jìn)行PCB設(shè)計(jì)的時(shí)候就要考慮放置更多的絲印信息，這樣在使用的時(shí)候會更方便，不用來回的查找原理圖或者找設(shè)計(jì)人員支持了。如果設(shè)計(jì)的是一個(gè)量產(chǎn)產(chǎn)品，那么就要更多的考慮到生產(chǎn)線上會遇到的問題，同類型的器件盡量方向一致，器件間距是否合適，板子的工藝邊寬度等等。這些問題考慮的越早，越不會影響后面的設(shè)計(jì)，也可以減少后面支持的工作量和改板的次數(shù)?？瓷先ラ_始設(shè)計(jì)上用的時(shí)間增加了，實(shí)際上是減少了自己后續(xù)的工作量。在板子空間信號允許的情況下，盡量放置更多的測試點(diǎn)，提高板子的可測性，這樣在后續(xù)調(diào)試階段同樣能節(jié)省更多的時(shí)間，給發(fā)現(xiàn)問題提供更多的思路。(四) 畫好原理圖很多工程師都覺得layout工作更重要一些，原理圖就是為了生成網(wǎng)表方便PCB做檢查用的。其實(shí)，在后續(xù)電路調(diào)試過程中原理圖的作用會更大一些。無論是查找問題還是和同事交流，還是原理圖更直觀更方便。另外養(yǎng)成在原理圖中做標(biāo)注的習(xí)慣，把各部分電路在layout的時(shí)候要注意到的問題標(biāo)注在原理圖上，對自己或者對別人都是一個(gè)很好的提醒。層次化原理圖，把不同功能不同模塊的電路分成不同的頁，這樣無論是讀圖還是以后重復(fù)使用都能明顯的減少工作量。使用成熟的設(shè)計(jì)總是要比設(shè)計(jì)新電路的風(fēng)險(xiǎn)小。每次看到把所有電路都放在一張圖紙上，一片密密麻麻的器件，腦袋就能大一圈。