山東開發(fā)線路板印制一、沉金板與鍍金板的區(qū)別二、為什么要用鍍金板隨著IC 的集成度越來越高，IC腳也越多越密。開發(fā)線路板印制而垂直噴錫工藝很難將成細的焊盤吹平整，這就給SMT的貼裝帶來了難度;另外噴錫板的待用壽命(shelf life)很短。而鍍金板正好解決了這些問題： 1對于表面貼裝工藝，尤其對于0603及0402 超小型表貼，因為焊盤平整度直接關(guān)系到錫膏印制工序的質(zhì)量，對后面的再流焊接質(zhì)量起到?jīng)Q定性影響，所以，整板鍍金在高密度和超小型表貼工藝中時常見到。2在試制階段，受元件采購等因素的影響往往不是板子來了馬上就焊，而是經(jīng)常要等上幾個星期甚至個把月才用，鍍金板的待用壽命(shelf life)比鉛錫合金長很多倍所以大家都樂意采用。再說鍍金PCB在度樣階段的成本與鉛錫合金板相比相差無幾。但隨著布線越來越密，線寬、間距已經(jīng)到了3-4MIL。因此帶來了金絲短路的問題：隨著信號的頻率越來越高，因趨膚效應造成信號在多鍍層中傳輸?shù)那闆r對信號質(zhì)量的影響越明顯：趨膚效應是指：高頻的交流電，電流將趨向集中在導線的表面流動。根據(jù)計算，趨膚深度與頻率有關(guān)：鍍金板的其它缺點在沉金板與鍍金板的區(qū)別表中已列出。

一、PCB沉金采用的是化學沉積的方法，通過化學氧化還原反應的方法生成一層鍍層，一般厚度較厚，是化學鎳金金層沉積方法的一種，可以達到較厚的金層。二、PCB鍍金采用的是電解的原理，也叫電鍍方式。其他金屬表面處理也多數(shù)采用的是電鍍方式。在實際產(chǎn)品應用中，90%的金板是沉金板，因為鍍金板焊接性差是他的致命缺點，也是導致很多公司放棄鍍金工藝的直接原因!沉金工藝在印制線路表面上沉積顏色穩(wěn)定，光亮度好，鍍層平整，可焊性良好的鎳金鍍層?；究煞譃樗膫€階段：前處理(除油，微蝕，活化、后浸)，沉鎳，沉金，后處理(廢金水洗，DI水洗，烘干)。沉金厚度在0.025-0.1um間。金應用于電路板表面處理，因為金的導電性強，抗氧化性好，壽命長，而鍍金板與沉金板最根本的區(qū)別在于，鍍金是硬金(耐磨)，沉金是軟金(不耐磨)。1、沉金與鍍金所形成的晶體結(jié)構(gòu)不一樣，沉金對于金的厚度比鍍金要厚很多，沉金會呈金黃色，較鍍金來說更黃(這是區(qū)分鍍金和沉金的方法之一)，鍍金的會稍微發(fā)白(鎳的顏色)。2、沉金與鍍金所形成的晶體結(jié)構(gòu)不一樣，沉金相對鍍金來說更容易焊接，不會造成焊接不良。沉金板的應力更易控制，對有邦定的產(chǎn)品而言，更有利于邦定的加工。同時也正因為沉金比鍍金軟，所以沉金板做金手指不耐磨(沉金板的缺點)。3、PCB沉金板只有焊盤上有鎳金，趨膚效應中信號的傳輸是在銅層不會對信號有影響。4、沉金較鍍金來說晶體結(jié)構(gòu)更致密，不易產(chǎn)成氧化。5、隨著電路板加工精度要求越來越高，線寬、間距已經(jīng)到了0.1mm以下。鍍金則容易產(chǎn)生金絲短路。沉金板只有焊盤上有鎳金，所以不容易產(chǎn)成金絲短路。

1)專門用于探測的測試焊盤的直徑應該不小于0.9mm 。2) 測試焊盤周圍的空間應大于0.6mm 而小于5mm 。如果元器件的高度大于6. 7mm，那么測試焊盤應置于該元器件5mm 以外。3) 在距離印制電路板邊緣3mm 以內(nèi)不要放置任何元器件或測試焊盤。4) 測試焊盤應放在一個網(wǎng)格中2.5mm孔的中心。如果有可能，允許使用標準探針和一個更可靠的固定裝置。5) 不要依靠連接器指針的邊緣來進行焊盤測試。測試探針很容易損壞鍍金指針。6) 避免鍍通孔-印制電路板兩邊的探查。把測試頂端通過孔放到印制電路板的非元器件/焊接面上。

從IC芯片的發(fā)展及封裝形式來看，芯片體積越來越小、引腳數(shù)越來越多;同時，由于近年來IC工藝的發(fā)展，使得其速度也越來越高。這就帶來了一個問題，即電子設(shè)計的體積減小導致電路的布局布線密度變大，而同時信號的頻率還在提高，從而使得如何處理高速信號問題成為一個設(shè)計能否成功的關(guān)鍵因素。隨著電子系統(tǒng)中邏輯復雜度和時鐘頻率的迅速提高，信號邊沿不斷變陡，印刷電路板的線跡互連和板層特性對系統(tǒng)電氣性能的影響也越發(fā)重要。對于低頻設(shè)計，線跡互連和板層的影響可以不考慮，但當頻率超過50 MHz時，互連關(guān)系必須考慮，而在*定系統(tǒng)性能時還必須考慮印刷電路板板材的電參數(shù)。因此，高速系統(tǒng)的設(shè)計必須面對互連延遲引起的時序問題以及串擾、傳輸線效應等信號完整性(Signal Integrity，SI)問題。當硬件工作頻率增高后，每一根布線網(wǎng)絡(luò)上的傳輸線都可能成為發(fā)射天線，對其他電子設(shè)備產(chǎn)生電磁輻射或與其他設(shè)備相互干擾，從而使硬件時序邏輯產(chǎn)生混亂。電磁兼容性(Electromagnetic Compatibility，EMC)的標準提出了解決硬件實際布線網(wǎng)絡(luò)可能產(chǎn)生的電磁輻射干擾以及本身抵抗外部電磁干擾的基本要求。1 高速數(shù)字電路設(shè)計的幾個基本概念在高速數(shù)字電路中，由于串擾、反射、過沖、振蕩、地彈、偏移等信號完整性問題，本來在低速電路中無需考慮的因素在這里就顯得格外重要;另外，隨著現(xiàn)有電氣系統(tǒng)耦合結(jié)構(gòu)越來越復雜，電磁兼容性也變成了一個不能不考慮的問題。要解決高速電路設(shè)計的問題，首先需要真正明白高速信號的概念。高速不是就頻率的高低來說的，而是由信號的邊沿速度決定的，一般認為上升時間小于4倍信號傳輸延遲時可視為高速信號。即使在工作頻率不高的系統(tǒng)中，也會出現(xiàn)信號完整性的問題。這是由于隨著集成電路工藝的提高，所用器件I/O端口的信號邊沿比以前更陡更快，因此在工作時鐘不高的情況下也屬于高速器件，隨之帶來了信號完整性的種種問題。

1.系統(tǒng)布局是否保證布線的合理或者最優(yōu)，是否能保證布線的可靠進行，是否能保證電路工作的可靠性。在布局的時候需要對信號的走向以及電源和地線網(wǎng)絡(luò)有整體的了解和規(guī)劃。2.印制板尺寸是否與加工圖紙尺寸相符，能否符合PCB制造工藝要求、有無行為標記。這一點需要特別注意，不少PCB板的電路布局和布線都設(shè)計得很漂亮、合理，但是疏忽了定位接插件的精確定位，導致設(shè)計的電路無法和其他電路對接。3.元件在二維、三維空間上有無沖突。注意器件的實際尺寸，特別是器件的高度。在焊接免布局的元器件，高度一般不能超過3mm。4.元件布局是否疏密有序、排列整齊，是否全部布完。在元器件布局的時候，不僅要考慮信號的走向和信號的類型、需要注意或者保護的地方，同時也要考慮器件布局的整體密度，做到疏密均勻。5.需經(jīng)常更換的元件能否方便地更換，插件板插入設(shè)備是否方便。應保證經(jīng)常更換的元器件的更換和接插的方便和可靠。6.調(diào)整可調(diào)元件是否方便。7.熱敏元件與發(fā)熱元件之間是否有適當?shù)木嚯x。8.在需要散熱的地方是否裝有散熱器或者風扇，空氣流是否通暢。應注意元器件和電路板的散熱。9.信號走向是否順暢且互連最短。10.插頭、插座等與機械設(shè)計是否矛盾。11.線路的干擾問題是否有所考慮。12.電路板的機械強度和性能是否有所考慮。13.電路板布局的藝術(shù)性及其美觀性。